2 模块设计方案
2.1 功能要求
该数字量采集模块主要功能是采集输入的36路数字及脉冲信号，并将编帧后的信号数据上传给上位机，上位机经解包处理后显示信号相应的状态进行判断。
根据设计要求，所测量的36路数字信号中，有15路正脉冲信号。它们均由一个同步脉冲信号触发，因此需要测量这些正脉冲的宽度和相对于同步信号脉冲的延时。
要求采集步长不能大于10 ns，即采集频率高于100 MHz。而其他数字信号需要显示高低电平状态，其中一路信号是固定频率信号，需测量其频率值。上位机要求显示所采集信号的状态。
2.2 模块原理框图
FPGA内部逻辑功能强大，外围电路设计基于简单、可靠的原则。该模块由FIFO、USB2.0单片机、光电隔离器等部分组成。36路数字信号经光电隔离器进入FPGA主控单元，以供采集；FPGA处理采集到的信号，转换成数据进行编帧，然后写入FIFO。USB单片机提取FIFO中的数据，通过USB电缆传送给上位机，上位机将传送来的数据解帧，然后显示所有信号状态。模块通过电源接口向各个部分供电。其原理框图如图1所示。
3 模块电路设计
3.1 FPGA配置电路
FPGA是采用XILINX公司的Spantan-II系列XC2S100E，该系列器件的内核采用2.5 V供电，工作频率高达200 MHz；I／O端口供电电压为3.3 V，可承受5 V的输入高电平。Spartan-II系列的FPGA具有丰富的I／O端口资源。其I／O端口输出缓冲器接收高达24 mA源出电流和48 mA灌入电流。
由于FPGA基于RAM工艺技术，掉电后不能保存信息，因此需要一个外置存储器来保存信息。采用一次可编程的PROM(高有效或低有效)XCF01SV020，其复位引脚的极性可编程设置，供电电压为3.3 V。XCF01SVO20的DONE、INIT、CCLK信号来自于FPGA XC2S100E。系统上电后，首先FPGA初始化，INIT、DONE置低。INIT置低后复位PROM，此时由于PROM的CE为低，因此选取PROM，从而可将数据流从DATA引脚输入到FPGA的DIN引脚。配置完成后，FPGA将DONE接高，PROM处于低功耗的待机模式，并将DATA引脚置为高阻态。图2为FPGA配置电路图。
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